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| VLSI설계및실험Practice1 / 1. addcnter.v 2. addcnter_TB.v 3. DFF.v 4. ripplecarrycounter.v 5. ripplecarrycounter_TB.v 6. TFF.v 7. VLSI설계및실험Practice1.hwp / 1. addcnter.v addcounter. v는 VLSI 설계에서 기본적인 카운터 기능을 구현하는 Verilog 파일이다. 이 파일은 주로 비동기 카운터 혹은 동기 카운터를 설계하는 데 사용된다. 카운터는 클럭 신호에 따라 값… |
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| VLSI설계및실험Practice4 / 1. carry_select_adder_20b.v 2. csa.v 3. D_FF_1.v 4. D_FF_11.v 5. D_FF_12.v 6. D_FF_16.v 7. D_FF_2.v 8. D_FF_20.v 9. D_FF_21.v 10. D_FF_22.v 11. D_FF_23.v 12. D_FF_3.v 13. D_FF_4.v 14. D_FF_5.v 15. D_FF_6.v 16. FA.v 17. FA_4.v 18. mux_2to1_1b.v 19. mux_2to1_2b.v 20. mux_2to1_3b.v 21. mux_2to1_4b.v 22. mux_2to1_5… |
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| VLSI 프로젝트 보고서 / 1. Microprocessor 1) 6T SRAM Cell 2) Precharge 3) Sense amplifier 4) Write Driver 5) MUX 6) Controller 2. 고찰 / 1. Microprocessor 마이크로프로세서는 현대 컴퓨터 시스템의 핵심 구성요소로, 다양한 기능을 수행하는 기초적인 처리 장치이다. CPU(Central Processing Unit)의 기능을 거의 완벽하게 수행하며, 명령어 집합, 데이터 처리, 제… |
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| [공학,기술] 정보통신 설계 - 집적 회로(Very Large Scale Integrated Circuit; VLSI)의 설계 과정 / 집적회로(VLSI)의 설계 과정 VLSI 설계 전반부 : Gate Level 설계 후반부 : Layout 데이터 생성 최근의 설계 전반부 : 동작적 설계(Behavioral Design) ` Gate Level 설계 후반부 : Layout 데이터 생성 2.1상위 레벨 합성(High Level Synthesis) 2비트 입력 4비트 출력 X(0) F(0)… |
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| [공학][시스템설계] CMOS VLSI LT 스파이스 / Example1 (1) Control Panel - LTspice의 제어 및 설정을 할 수 있다. (2) 회로 ↑ Highlight Net(같은 노드 표시) (3) 회로 - Transient Analysis : 시간에 따른 회로 분석 - DC Analysis : DC 특성 분석 Example2 (1) OP-AMP 증폭기 설계 opamp의 내부회로를 꾸민다Hierarchy탭에서 Create a new symbol 클릭 - draw기능으로 s… |
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| 부경대학교 VLSI 과제(CMOS 인버터) 실험보고서 / 1. 설계 과정 1) wafer 준비 2) n-well 3) active region 4) gate 5) S/D_NMOS 6) S/D_PMOS 7) annealing 8) contact 9) metallization 10) electrode 11) mask 2. 도핑농도, Junction depth 1) NMOS의 도핑농도, Junction depth 2) PMOS의 도핑농도, Junction depth 3. 입출력 파형 비교 1) DC 2) 1kHz 3) 100kHz 4) … |
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| VLSI 설계 및 실험 Practice10 / 1. Butter.v 2. Butter_DFF.v 3. D_FF_16.v 4. D_FF_32.v 5. mul.v 6. mul_DFF.v 7. stimulus_Butter.v 8. stimulus_mul.v 9. VLSI설계및실험Practice10.hwp / 1. Butter.v Butter. v는 디지털 회로 설계에서 사용되며, 주로 필터 디자인에 관한 내용을 포함하고 있다. 이 설계는 VLSI(초대량 집적 회로)에서의 필터 함수 구현을 목표로 하며… |
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| 부경대학교 VLSI 과제(CMOS 인버터) 실험보고서 / 1. 설계 과정 1) wafer 준비 2) n-well 3) active region 4) gate 5) S/D_NMOS 6) S/D_PMOS 7) annealing 8) contact 9) metallization 10) electrode 11) mask 2. 도핑농도, Junction depth 1) NMOS의 도핑농도, Junction depth 2) PMOS의 도핑농도, Junction depth 3. 입출력 파형 비교 1) DC 2) 1kHz 3) 100kHz 4) … |
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| 인하대 vlsi 4주차 xor / 1. 실습 이론 2. 실습내용 (01)Layout (02) Hspice( Magic Tool을 이용하여 추출한 netlist파일 & dc, tran시뮬레이션) 3. 고찰 / 1. 실습 이론 VLSI에서 XOR 게이트는 디지털 회로에서 중요한 기능을 수행하는 기본 논리 게이트 중 하나이다. XOR는 `Exclusive OR`의 약자로, 두 입력 값 중 하나가 참일 때만 출력이 참이 되는 특성을 가진다. 즉, 두… |
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| 인하대 vlsi 2주차 inveter / 1. 실습 이론 2. 실습내용 01. Layout 02. Hspice( Magic Tool을 이용하여 추출한 netlist파일 & dc, tran시뮬레이션) 03.직접 손으로 작성한 netlist 파일 & dc, tran시뮬레이션 3. 고찰 01.각 layer에 대한 설명 02. Inverter의 이상적인 pMOS와 nMOS의 비율 03. Process에 의한 공정 fff,sss,ttt corner에 대한 차이점 분석 / 1. 실습 이론 … |
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![[공학,기술] 정보통신 설계 - 집적 회로(Very Large Scale Integrated Circuit; VLSI)의 설계 과정](/View/[공학,기술] 정보통신 설계 - 집적 회로(Very Large Scale Integrated Circuit; VLSI)의 설계 과정_hwp_01_.gif)
의 설계 과정_hwp_01_.gif',20,'레포트','공학기술',3000) "미리보기"){kind=small}
![[공학][시스템설계] CMOS VLSI LT 스파이스](/View/[공학][시스템설계] CMOS VLSI LT 스파이스_hwp_01_.gif)
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 실험보고서_hwp_01_.gif',20,'방송통신','기타',3000) "미리보기"){kind=small}
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